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第11講 Registers and Counters
課程影音
L11A
L11A
Registers and Register Transfer
L11B
Parallel Adder with Accumulator
L11C
Shift Registers
L11D
Design of a Binary Counter
L11E
Design of a Binary Counter - Up-down Counter
L11F
Design of a Binary Counter - Loadable Counter with Count Enable
L11G
Counters for Other Sequences - T Flip-Flop
L11H
Counters for Other Sequences - D Flip-Flop, S-R Flip-Flop, J-K Flip-Flop
資料下載
- 資工系王俊堯教授數位邏輯設計Unit 1_Introduction Number Systems
- 資工系王俊堯教授數位邏輯設計Unit 2_Boolean Algebra.pdf
- 資工系王俊堯教授數位邏輯設計Unit 3_Boolean Algebra (Continued).p
- 資工系王俊堯教授數位邏輯設計Unit 4_Application of Boolean Algebr
- 資工系王俊堯教授數位邏輯設計Unit 5_Karnaugh Maps.pdf
- 資工系王俊堯教授數位邏輯設計Unit 6_Quine-McClusky Method.pdf
- 資工系王俊堯教授數位邏輯設計Unit 7_Multi-Level Gate Circuits NA
- 資工系王俊堯教授數位邏輯設計Unit 8_Combinational Circuit Design
- 資工系王俊堯教授數位邏輯設計Unit 9_Multiplexers, Decoders, and P
- 資工系王俊堯教授數位邏輯設計Unit11_Flip-Flops.pdf
- 資工系王俊堯教授數位邏輯設計Unit12_Relationship of the units.pdf
- 資工系王俊堯教授數位邏輯設計Unit13_Analysis of Clocked Sequentia
- 資工系王俊堯教授數位邏輯設計Unit14_Relationship of the Units.pdf
- 資工系王俊堯教授數位邏輯設計Unit15_Reduction of State Tables St
- (A)Logic Design (Verilog).pdf
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